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基于FPGA内部的一种模拟并行接口电路及其实现方法

基本信息

申请号 CN201110452701.5 申请日 -
公开（公告）号 CN102594331B 公开（公告）日 2014-10-01
申请公布号 CN102594331B 申请公布日 2014-10-01
分类号 H03K19/0175(2006.01)I 分类 基本电子电路;
发明人 张杭;严结实;刘吕娜 申请（专利权）人 西安西电自动化控制系统有限责任公司
代理机构 西安通大专利代理有限责任公司 代理人 徐文权
地址 710075 陕西省西安市唐兴路7号
法律状态 -

摘要

摘要 本发明提供了一种基于FPGA内部的一种模拟并行接口电路及其实现方法，包括读写和选通产生模块、UFM地址、数据产生模块、UFM察除信号产生模块、UFM模块，以及数据锁存模块，CPU产生的读、写信号、在读写和选通产生模块内经延时和整形处理后生成满足UFM时序要求的读、写信号以及读、写选通信号，UFM地址、数据产生模块根据读、写选通信号生成地址总线或地址总线和数据总线，其中，写信号的地址总线和数据总线上对应的内容被保存在UFM模块内，读信号的地址总线上的内容在读信号有效的情况下被锁存在数据锁存模块内。通过本发明接口电路，外部CPU可以直接访问UFM，实现随时存取数据的目的。