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一种多层堆叠的3D-SIP芯片测试方法

基本信息

申请号 CN201910024235.7 申请日 -
公开（公告）号 CN109596974A 公开（公告）日 2019-04-09
申请公布号 CN109596974A 申请公布日 2019-04-09
分类号 G01R31/28（2006.01）I 分类 测量；测试;
发明人 张凯虹; 徐德生; 奚留华; 武乾文 申请（专利权）人 无锡中微腾芯电子有限公司
代理机构 无锡市大为专利商标事务所（普通合伙） 代理人 无锡中微腾芯电子有限公司
地址 214035 江苏省无锡市新吴区长江路21号
法律状态 -

摘要

摘要 本发明涉及集成电路测试技术领域，具体公开了一种多层堆叠的3D‑SIP芯片测试方法，其中，所述3D‑SIP芯片测试方法包括：获取故障代码自定义表；加载测试程序至芯片测试装置；根据故障代码自定义表并结合测试程序对多层集成电路芯片进行功能测试；其中，所述芯片测试装置用于执行测试程序以及用于安装所述多层集成电路芯片。本发明提供的多层堆叠的3D‑SIP芯片测试方法实现了对多层集成电路芯片进行功能自动测试，且省去了管脚数量多、开发程序复杂的麻烦，还可以多次测试，灵活应用，实现了100%的功能测试。