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一种过采样数据时钟恢复的FPGA实现系统及方法

基本信息

申请号 CN201610349260.9 申请日 -
公开（公告）号 CN106021025B 公开（公告）日 2019-03-29
申请公布号 CN106021025B 申请公布日 2019-03-29
分类号 G06F11/14（2006.01）I 分类 计算；推算；计数;
发明人 邱建刚 申请（专利权）人 成都欧飞凌通讯技术有限公司
代理机构 成都君合集专利代理事务所（普通合伙） 代理人 成都欧飞凌通讯技术有限公司
地址 610000 四川省成都市高新区云华路333号3栋3层
法律状态 -

摘要

摘要 本发明公开了一种过采样数据时钟恢复的FPGA实现系统及方法，它包括设置在FPGA内的差分信号转换模块、可编程输入延时单元、输入串并转换模块及固定模式时钟管理模块，所述差分信号转换模块连接可编程输入延时单元，所述可编程输入延时单元连接输入串并转换模块，所述输入串并转换模块连接固定模式时钟管理模块；通过差分信号转换模块将外部送入FPGA的输入差分信号进行缓存处理分成差分的2个FPGA内部的差分信号；针对FPGA芯片上不能提供充足的GE口专用管脚问题，设计出一种通过普通IO也能实现数据时钟恢复的方法；利用普通IO做数据恢复，可以灵活满足各种需求，在实现数量上不再局限于芯片自带的专用管脚。