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一种低复杂度1比特信号解码器及其设计方法

基本信息

申请号 CN202011419084.4 申请日 -
公开（公告）号 CN112436823A 公开（公告）日 2021-03-02
申请公布号 CN112436823A 申请公布日 2021-03-02
分类号 H03H17/02(2006.01)I 分类 基本电子电路;
发明人 谷秋琳 申请（专利权）人 西安赫至创芯信息科技有限公司
代理机构 西安通大专利代理有限责任公司 代理人 张海平
地址 710000陕西省西安市曲江新区雁翔路3269号旺座曲江G座2107-09号
法律状态 -

摘要

摘要 一种低复杂度1比特信号解码器及其设计方法，解码器包括计数器模块、固定减法模块、M个解码器子模块以及输出控制信号产生模块；计数器模块输入复位信号与时钟信号，M个解码器子模块组成并行运算处理单元，M‑1个固定减法模块一一对应的设置在计数器模块与解码器子模块之间，相邻解码器子模块的地址数值相差L；M个解码器子模块的数据输入均为1比特的数字信号流，使能端均连接输出控制信号产生模块，输出均为N比特的数字信号流。本发明还提供了一种低复杂度1比特信号解码器的设计方法。本发明具有极低的复杂度和功耗，适合高速数据的处理，能够以集成电路的形式实现，适用于高带宽的信号处理。