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一种锁相环频率综合器

基本信息

申请号 CN202122373470.0 申请日 -
公开（公告）号 CN215956368U 公开（公告）日 2022-03-04
申请公布号 CN215956368U 申请公布日 2022-03-04
分类号 H03L7/085（2006.01）I;H03L7/093（2006.01）I;H03L7/18（2006.01）I 分类 基本电子电路;
发明人 韩怀宇;赵伟兵;邵要华 申请（专利权）人 珠海一微半导体股份有限公司
代理机构 - 代理人 -
地址 519000广东省珠海市横琴新区环岛东路3000号2706
法律状态 -

摘要

摘要 本实用新型公开一种锁相环频率综合器，包括：前置分频器，用于接收外部电路输入的时钟信号，并对时钟信号进行分频；锁相环电路，用于接收所述前置分频器输出的分频后的时钟信号，并输出2N个相位依次变化的时钟信号；N倍频电路，包括或门、N级异或门和N级与门，用于接收所述锁相环电路输出的2N个相位依次变化的时钟信号，并将2N个相位依次变化的时钟信号进行倍频处理，以输出一个N倍频的最终时钟信号作为所述锁相环频率综合器输出的时钟信号。本实用新型在实现高频时钟信号输出的同时大幅度降低频率综合器的功耗，且本实用新型的N倍频电路不受时钟信号占空比的影响，无需采用占空比校正电路，简化频率综合器结构。